cache是一種內(nèi)存,叫高速緩存。
從容量來說:CPU< 寄存器< cache< DDR
從速度來說:CPU >寄存器 >cache >DDRcache 的存在,是因為寄存器和 ddr 之間速度差異太大,ddr 的速度遠不能滿足寄存器的需要(不能滿足 cpu 的需要,所以沒有 cache 會拉低整個系統(tǒng)的整體速度)。

整個系統(tǒng)中 CPU 的供應(yīng)鏈由:寄存器 + cache + DDR + 硬盤/flash 四階組成,這是綜合考慮了性能、成本后得到的妥協(xié)的結(jié)果。
210內(nèi)部有 32KB icache和 32kb dcache。icache 是用來緩存指令的;dcache是用來緩存數(shù)據(jù)的。
cache 的意義:指令平時是放在 硬盤/flash 中的,運行時讀取到 DDR 中,再從 DDR 中讀給寄存器,再由寄存器送給 cpu 。但是 DDR 的速度和寄存器(代表的就是 CPU)相差太大,如果 CPU 運行完一句再去 DDR 讀取下一句,那么 CPU 的速度完全就被 DDR 給拖慢了。解決方案就是 icache。
icache 工作時,會把我們 CPU 正在運行的指令的旁邊幾句指令事先給讀取到 icache 中( CPU 設(shè)計有一個基本原理:代碼執(zhí)行時,下一句執(zhí)行當前一句代碼旁邊代碼的可能性要大很多)。當下一句 CPU 要指令時,cache 首先檢查自己事先準備的緩存指令中有沒這句,如果有就直接拿給 CPU,如果沒有則需要從 DDR 中重新去讀取拿給 CPU,并同時做一系列的動作:清緩存、重新緩存。
首先,icache 的一切動作都是自動的,不需人為干預(yù)。我們所需要做的就是打開/關(guān)閉 icache。
其次,在 210 的 iROM 中 BL0 已經(jīng)打開了 icache。所以之前看到的現(xiàn)象都是 icache 打開時的現(xiàn)象。

mrc p15,0,r0,c1,c0,0; // 讀出cp15的c1到r0中
bic r0, r0, #(1<<12) // bit12 置0 關(guān)icache
orr r0, r0, #(1<<12) // bit12 置1 開icache
mcr p15,0,r0,c1,c0,0;實驗驗證我們來看三種情況下的實驗現(xiàn)象:
1 直接使用 BL0 中對 icache 的操作
2 關(guān) icache
3 開 icache
實驗結(jié)果分析:
結(jié)論1:irom 中確實是打開了 icache 的。
結(jié)論2:icache 關(guān)閉確實比 icache 打開時 led 閃爍變慢,說明指令執(zhí)行速度變慢。源自朱有鵬老師.
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當前標題:ARM匯編寫啟動代碼之開iCache-創(chuàng)新互聯(lián)
文章URL:http://www.chinadenli.net/article28/djdhcp.html
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