Verilog中的$display和$write任務(wù)

1、格式

      $display(p1,p2, …,pn);

目前累計(jì)服務(wù)客戶1000+，積累了豐富的產(chǎn)品開發(fā)及服務(wù)經(jīng)驗(yàn)。以網(wǎng)站設(shè)計(jì)水平和技術(shù)實(shí)力，樹立企業(yè)形象，為客戶提供成都做網(wǎng)站、成都網(wǎng)站建設(shè)、網(wǎng)站策劃、網(wǎng)頁設(shè)計(jì)、網(wǎng)絡(luò)營銷、VI設(shè)計(jì)、網(wǎng)站改版、漏洞修補(bǔ)等服務(wù)。創(chuàng)新互聯(lián)始終以務(wù)實(shí)、誠信為根本，不斷創(chuàng)新和提高建站品質(zhì)，通過對領(lǐng)先技術(shù)的掌握、對創(chuàng)意設(shè)計(jì)的研究、對客戶形象的視覺傳遞、對應(yīng)用系統(tǒng)的結(jié)合，為客戶提供更好的一站式互聯(lián)網(wǎng)解決方案，攜手廣大客戶，共同發(fā)展進(jìn)步。

      $write(p1,p2, …,pn);

這兩個函數(shù)和系統(tǒng)任務(wù)的作用都是用來輸出信息，即將參數(shù)p2到pn按參數(shù)p1給定的格式輸出。參數(shù)p1通常稱為：“格式控制”，參數(shù)p2至pn通常稱為“輸出列表”。

$display自動地在輸出后進(jìn)行換行，$write則不是這樣。如果想在一行里輸出多個信息，可以使用$write。如：$display(“%d”,10) 和 $display(“%d\n”,10) 效果相同

在$display和$write中，其輸出格式控制是用雙引號括起來的字符串，它包括以下兩種信息：

1、格式說明，由”%”和格式字符組成。它的作用是將輸出的數(shù)據(jù)轉(zhuǎn)換成指定的格式輸出。格式說明總是由”%”字符開始的。下面是幾種常用的輸出格式。

      （1）、 %h或%H       以十六進(jìn)制的形式輸出

      （2）、 %d或%D       以十進(jìn)制的形式輸出

      （3）、 %o或%O       以八進(jìn)制的形式輸出

      （4）、 %b或%B       以二進(jìn)制的形式輸出

（5）、 %c或%C       以ASCII碼字符的形式輸出

（6）、 %v或%V      輸出網(wǎng)絡(luò)型數(shù)據(jù)信號強(qiáng)度

（7）、 %m或%M      輸出等級層次的名字

（8）、 %s或%S       以字符串的形式輸出

（9）、 %t或%T       以當(dāng)前的時間格式的形式輸出

（10）、 %e或%E       以指數(shù)的形式輸出實(shí)型數(shù)

（11）、%f或%F       以十進(jìn)制的形式輸出實(shí)型數(shù)

（12）、%g或%G       以指數(shù)或者十進(jìn)制的形式輸出實(shí)型數(shù)，無論何種格式都以較短的結(jié)果輸出。

（13）、%x  十六進(jìn)制

（14）、%i   讀入十進(jìn)制，八進(jìn)制，十六進(jìn)制，在編譯時通過數(shù)據(jù)前置來區(qū)分

如：%i0x31 表示為十六進(jìn)制 %i031 表示為八進(jìn)制 %i31 表示為十進(jìn)制

（15）、%u  無符號十進(jìn)制數(shù)

2、普通字符，即需要原樣輸出的字符。其中包括一些轉(zhuǎn)義字符，下面的字符形式用于格式字符串參數(shù)中，用來顯示特殊的字符。

      （1）、 \n   換行

      （2）、 \t 相當(dāng)于按一個Tab鍵

      （3）、 \\ 反斜杠字符\

（4）、 \”  雙引號字符”

      （5）、 \0 八進(jìn)制數(shù)代表的字符

      （6）、 \0x 十六進(jìn)制數(shù)代表的字符

      （7）、 %% 百分符號%

在 Verilog 中， 轉(zhuǎn)義符 一定是使用在雙引號括起來的字符串中！

2、%v %m %t

1、%v用于打印一個線網(wǎng)類型變量的信號強(qiáng)度，它不能打印矢量變量的信號強(qiáng)度，而只能打印標(biāo)量變量，或者矢量變量的指定位的信號強(qiáng)度。信號強(qiáng)度用3個符號輸出表示，前兩個符號表示信號強(qiáng)度，而第三個符號表示信號的邏輯值。信號強(qiáng)度和邏輯值的意義分別如下面兩個表所示：

　　信號邏輯值表示：

邏輯值 表示意義
0 表示邏輯0值
1 表示邏輯1值
X 表示邏輯不定態(tài)
Z 表示邏輯高阻態(tài)
L 表示邏輯0值，或者邏輯高阻態(tài)
H 表示邏輯1值，或者邏輯高阻態(tài)

　　信號強(qiáng)度表示：

標(biāo)記符 強(qiáng)度名 強(qiáng)度值表示
Su 電源級驅(qū)動(Supply drive) 7
St 強(qiáng)驅(qū)動(Strong drive) 6
Pu 上拉級驅(qū)動(Pull drive) 5
La 大容性(Large caPACitor) 4
We 弱驅(qū)動(Weak drive) 3
Me 中級容性(Medium capacitor) 2
Sm 小容性(Small capacitor) 1
Hi 高容性(High capacitor) 0

用%v打印一個信號的強(qiáng)度時，前兩個符號除了用上表中的信號強(qiáng)度“標(biāo)志符”表示信號強(qiáng)度外，也可以用兩個數(shù)字表示信號強(qiáng)度。關(guān)于信號強(qiáng)度和邏輯值的建模在后續(xù)章節(jié)進(jìn)行詳細(xì)介紹。

2、使用%m，可以打印當(dāng)前打印語句所在的模塊層次。 3、%t 通常用于打印當(dāng)前的仿真時間，當(dāng)然也可以用于打印其他數(shù)據(jù)。該轉(zhuǎn)義符表示把對應(yīng)的變量使用當(dāng)前使用的時間表示格式進(jìn)行打印。Verilog提供 系統(tǒng)函數(shù) $time獲得當(dāng)前的仿真時間信息，該系統(tǒng)函數(shù)輸出值為64比特表示的整數(shù)。Verilog還提供系統(tǒng)函數(shù)$timeformat用于設(shè)定當(dāng)前的時間格式。關(guān)于$time和$timeformat的使用也放在后續(xù)章節(jié)說明。

可以顯示全層次路徑名，包括模塊實(shí)例、任務(wù)、函數(shù)、命名塊。

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名稱欄目：verilog中的$display和$wirte-創(chuàng)新互聯(lián)
文章地址：http://www.chinadenli.net/article22/iiecc.html

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